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用 Verilog HDL 写的 SDRAM core 源程序(已通过测试)

上传者: 2020-05-19 08:52:56上传 ZIP文件 28.45KB 热度 28次
用VerilogHDL写的SDRAMcore源程序(已通过测试) SDRAMcoresourceprogramwritteninVerilogHDL(tested)
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