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uart16550的逻辑core代码已测试通过

上传者: 2019-01-12 22:49:00上传 RAR文件 145.24KB 热度 18次
串口16550的core代码,UART16550的基本结构由CPU接口模块、波特率发生器、FIFO控制器、发送/接收FIFO和发送/接收模块共7个部分组成。 CPU通UART的CPU接口模块配置整个UART, 波特率发生器在CPU写入初始值后产生需要的波特率,控制发送和接收模块在设定的波特率下工作。CPU通过接口模块向发送 FIFO内写入需要发送的8位数据,同时发送模块开始读取FIFO中的数据,并加入起始位、奇偶校验位和停止位后以串行发送的方式传输给串行接收设备。
用户评论
码姐姐匿名网友 2019-01-12 22:49:00

写的不错,有助于我理解

码姐姐匿名网友 2019-01-12 22:49:00

FPGA可以用,很好

码姐姐匿名网友 2019-01-12 22:49:00

不错,有些地方要改

码姐姐匿名网友 2019-01-12 22:49:00

还可以 很全面

码姐姐匿名网友 2019-01-12 22:49:00

还可以,但是不是vhdl的,呵呵