VHDL设计数字钟

Name: VHDL设计 数字钟
Rating: 4.5 (29 reviews)
Author: foot_91468

上传者：foot_91468 2021-04-23 14:58:08上传 RAR文件 213.07KB 热度 29次

包括60单独进制和24进制,采用vhdl语言设计各个子文件,顶层原理图设计。

下载地址

用户评论

更多下载

下载地址

立即下载

用户评论

VHDL数字钟设计

大小：0B | 2019-01-08 15:39:58
数字钟VHDL

大小：0B | 2019-01-18 15:04:15
数字钟的vhdl设计

大小：0B | 2019-03-01 23:41:02
VHDL设计数字钟

包括60单独进制和24进制,采用vhdl语言设计各个子文件,顶层原理图设计。

大小：213KB | 2021-04-23 14:58:08
VHDL数字钟的设计

实现了时钟、分钟、秒钟分别计数，按键key0控制分钟加一，按键key1控制时钟加一，按键key3控制...

大小：0B | 2019-07-06 00:27:36
数字钟的VHDL设计

大小：0B | 2019-03-01 02:26:22
数字钟vhdl

大小：0B | 2019-02-26 21:00:08
VHDL数字钟

大小：0B | 2019-03-14 03:18:59
vhdl数字钟

大小：0B | 2019-01-07 11:21:03
VHDL数字钟设计源码

大小：0B | 2019-03-01 02:25:58
vhdl设计的数字钟

大小：0B | 2019-01-18 15:03:57
多功能数字钟数字钟VHDL语言

大小：0B | 2018-12-07 17:12:18
VHDL设计多功能数字钟

数字逻辑课程设计报告，实现多功能数字钟的设计，功能：计时,并且可以24小时制和12小时制转换，闹钟，...

大小：0B | 2019-08-01 22:09:15
基于VHDL的数字钟设计

基于VHDL的数字钟课程设计报告目录摘要3引言31数字钟的设计框图32功能说明43模块设计部分43....

大小：0B | 2019-06-04 23:40:38
基于VHDL数字钟的设计

EDA技术在电子系统设计领域越来越普及，本设计主要利用VHDL语言在EDA平台上设计一个电子数字钟，...

大小：0B | 2019-04-30 12:21:24
数字钟基于VHDL的设计

基于VHDL语言的数字中的设计功能有：数字钟整点报时闹钟校时

大小：0B | 2018-12-25 19:59:47

VHDL设计 数字钟

VHDL设计数字钟