基于异步NOC机制的Booth乘法器设计

Name: 基于异步NOC机制的Booth乘法器设计
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Author: caoyunmei

上传者：caoyunmei 2021-04-18 20:32:47上传 PDF文件 2.62MB 热度 37次

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基于异步NOC机制的Booth乘法器设计

基于异步NOC机制的Booth乘法器设计

大小：2.62MB | 2021-04-18 20:32:47
booth乘法器

Booth multiplier

大小：0B | 2019-06-22 14:32:07
booth乘法器设计报告

华中科大的booth乘法器报告，写的很详细，包括原理和代码

大小：0B | 2019-05-15 13:58:16
booth乘法器实现

基于booth算法的乘法器，采用移位来代替普通加法，对于FPGA等移位快于加法的器件很有参考价值

大小：0B | 2019-07-14 23:58:01
基于booth算法的乘法器代码

基于booth算法的乘法器代码，清晰实用！可复用性强

大小：0B | 2019-07-07 00:00:09
采用booth算法的乘法器设计

别人写的论文大家可以参考一下还是挺不错的

大小：127KB | 2020-09-02 01:29:50
booth算法乘法器实现

布斯乘法实现实例mul14x15算法实现PDF文档

大小：0B | 2019-07-07 00:00:15
64位booth乘法器

64-bit booth multiplier

大小：0B | 2019-06-22 14:32:04
booth乘法器test bench

booth乘法器的测试代码testbench

大小：0B | 2019-07-06 23:59:50
8位Booth乘法器

Booth乘法器及测试8*8bitbooth乘法器及测试modulemultiplier(prod,...

大小：0B | 2019-07-07 00:00:06
booth乘法器verilogHDL代码

大小：0B | 2019-03-04 12:25:14
基于booth算法的乘法器的verilog实现

8位Booth乘法器设计,8位乘8位的基2的booth乘法器的verilog实现。满足1)利用硬件描...

大小：0B | 2020-06-11 17:32:34
booth乘法器经典中的经典

booth乘法器首先,当然是研究Booth算法了,然后就是那一组数举例,对着每一次运算分析,理解算法...

大小：0B | 2019-07-20 03:21:52
基于booth算法的乘法器的verilog HDL实现

基于booth算法的乘法器的verilogHDL实现。

大小：0B | 2019-05-28 01:19:06
Verilog32位booth乘法器

32位有符号数Booth乘法器，用Verilog代码实现，只是初级的设计。

大小：0B | 2020-05-13 19:21:43
采用Booth算法的16×16并行乘法器设计

16×16 parallel multiplier design using Booth algor...

大小：0B | 2019-06-25 21:14:45