EDA/PLD中的基于多相滤波的数字接收机的FPGA实现

0 引言 信道化接收机是在并行多通道接收机基础上提出的全概率频分信道化接收机,它克服了多部接收机并行工作、多通道 下变频等方案具有的设备复杂,各通道性能不一致和可靠性差的缺点。数字信道化接收机具备大的瞬时带宽、较高的灵 敏度、大的动态范围,能够检测和处理同时到达的信号、准确的参数测量能力和一定的信号识别能力。直接信道化接收 机的运算量大且输出速率与采样速率相同,实现困难,后续处理的压力很大,高速ADO与慢速信号处理器(FPGA,DSP) 是一个“瓶颈”;基于多相滤波的信道化接收机抽取在滤波之前,运算量小,且输出速率低,便于FPGA实现,这使得在 一片FPGA中实现数字信道化成为可能。本文