基于vhdl的数字时钟设计

Name: 基于vhdl的数字时钟设计
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Author: wcmlgb

上传者：wcmlgb 2019-06-23 20:16:24上传 DOC文件 1.16MB 热度 61次

Digital clock design based on vhdl

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基于VHDL的数字时钟设计

Digital clock design based on VHDL

大小：0B | 2019-06-28 00:40:09
基于vhdl的数字时钟设计

Digital clock design based on vhdl

大小：0B | 2019-06-23 20:16:24
基于VHDL的数字时钟的设计

随着EDA技术的发展和应用领域的扩大与深入,EDA技术在电子信息、通信、自动控制及计算机应用领域的重...

大小：0B | 2019-12-30 02:12:13
基于VHDL语言的数字时钟设计

分为四个模块分别是分频器、计数置数器、扫描显示电路、转换电路在max+plusII中进行编译即可

大小：0B | 2018-12-19 04:32:06
基于VHDL的数字时钟

大小：0B | 2019-01-18 15:03:55
基于vhdl的数字时钟

大小：0B | 2018-12-08 11:19:54
数字时钟vhdl设计

Digital clock vhdl design

大小：0B | 2019-06-28 00:39:27
数字时钟设计VHDL

设计一个可以计时的数字时钟，其显示时间范围是00:00:00~23:59:59，且该时钟具有暂停计时...

大小：0B | 2019-09-27 19:57:21
VHDL数字时钟设计

VHDL digital clock design

大小：0B | 2019-06-28 00:39:12
vhdl数字时钟设计

Vhdl digital clock design

大小：0B | 2019-06-22 06:11:45
基于VHDL的多功能数字时钟设计

用VHDL硬件描述语言，在实验箱上设计多功能数字时钟，可以实现时间设置、闹钟设置、整点响铃的功能，并...

大小：0B | 2019-05-05 05:21:59
基于vhdl数字时钟设计源码包

大小：0B | 2018-12-08 11:20:41
基于VHDL数字电子时钟设计

程序通过试验是没有错误的，已经做出实物！供大家使用！！！供大家使用！！！供大家使用！！！

大小：0B | 2019-09-18 19:19:34
简易数字时钟的设计vhdl

大小：0B | 2018-12-07 17:10:35
VHDL数字时钟设计可用

个人数字逻辑课程设计作品，全部编译通过在实验板上可行，传上来分享一下，希望对大家有帮助。

大小：0B | 2018-12-19 04:20:53
基于vhdl的数字时钟时间可调

用VHDL写的数字时钟在CYCLONE2上验证通过

大小：0B | 2019-05-16 06:22:01