-
在FPGA设计中,<code>syn_keep</code>属性用于指示综合...
大小:44428 | 2025-01-01 19:19:38 -
标题:float_add.v Verilog实现浮点数加法运算,采用单精度浮点型格式。支持硬件浮点数...
大小:6068 | 2024-12-29 03:58:04 -
<strong>标题</strong>:float_multi.v <...
大小:2978 | 2024-12-29 03:55:17 -
发生错误:响应格式错误
大小:6068 | 2024-12-29 03:53:05 -
FPGA Verilog浮点数除法运算,采用单精度浮点型小数格式,运算结果精度可设置,可封装成IP核...
大小:2.65KB | 2021-05-01 10:37:59 -
FPGA veri采用nios软核后,固化程序的几种方法,ram、epcs中的启动方法不同,都有详细...
大小:431.59KB | 2021-04-18 04:08:58 -
FPGA Verilog通过spi接口程序,来控制flash的读写,对flash数据进行读写测试,可...
大小:5.76KB | 2020-10-08 11:27:17 -
FPGA Verilog 串口发送程序,16个clock发送一个bit, 一个起始位,8个数据位,一...
大小:3.83KB | 2020-07-18 16:22:05 -
基于atleraFPGA芯片的niosii教程,如何搭建软核,如何配置硬件和软件编程,手把手教学
大小:23.53MB | 2020-05-19 02:04:29 -
使用NiosII处理器通过UART接口对Max10FPGA器件进行远程系统更新 本参考设计提供了一...
大小:344KB | 2020-05-17 18:41:11
Ta的上传资源列表