通用的VerilogHDL奇数偶数分频器

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通用的VerilogHDL奇数偶数分频器

大小：0B | 2019-01-13 17:17:55
奇数分频器的VerilogHDL实现

大小：0B | 2019-02-16 12:47:01
verilog偶数分频器

大小：0B | 2019-03-02 23:49:37
verilog奇数分频器

内含verilog语言编写的奇数分频器，本人认为代码比较简练，容易移植

大小：0B | 2019-07-10 15:58:03
1奇数分频器

奇数分频器，计数器位宽设置为6位，最高可设置63分频。通过更改计数器位宽和分频系数可以达到设计所需的...

大小：0B | 2019-08-17 17:21:19
fpga的奇数分频器

使用fpga制作的奇数的占空比为50%的分频器

大小：2KB | 2020-08-21 04:51:29
FPGA奇数和偶数分频器和半整数及任意小数分频器设计

在 FPGA 上实现了奇数和偶数分压器、半整数和任意小数分压器的设计。

大小：0B | 2019-06-21 04:48:22
verilog实现奇数偶数分频通用代码

该代码可以实现任意的奇数偶数分频

大小：61KB | 2021-01-13 12:31:05
verilog编写的偶数分频器

verilog编写的偶数分频器

大小：0B | 2019-07-27 07:54:06
verilog HDL奇数分频器

用FPGA实现占空比为50%的方波的奇数分频，语言为verlogHDL，已仿真验证OK

大小：0B | 2019-07-10 15:58:07
基于Verilog的偶数奇数半整数分频以及任意分频器设计

基于Verilog的偶数、奇数、半整数分频以及任意分频器设计

大小：0B | 2019-07-24 18:22:18
verilog语言奇数分频器

N倍奇数分频器的verilog程序，详细讲解原理。

大小：0B | 2019-07-18 17:57:31
任意奇数分频器Verilog代码

大小：0B | 2019-01-11 23:29:32
VerilogHDL编写任意奇数分频

已通过Quartusii7.2编译，有助于学习。

大小：0B | 2019-05-06 06:24:10
verlog HDL语言奇数分频器

用FPGA实现占空比为50%的方波的奇数分频,语言为verlog HDL,已仿真验证OK

大小：323KB | 2020-08-21 04:51:33
verilog的奇数倍偶数倍分频器程序

verilog的奇数倍,偶数倍分频器程序,想从基础开始学习的同学可以分享。

大小：28KB | 2020-10-29 06:34:44