verilog实现16位cpu 上传者：tulangui 2018-12-08 09:03:29上传 RAR文件 478.75KB 热度 74次 用verilog实现16位cpu，8位存储器，能进行加减乘除和逻辑运算，支持栈，支持函数调用，跳转功能等 下载地址 用户评论 更多下载 下载地址 立即下载 收藏 腾讯 微博 用户评论 码姐姐匿名网友 2018-12-08 09:03:29 挺不错的，不过工程好像有些问题 码姐姐匿名网友 2018-12-08 09:03:29 挺好的资源，不过对于初学者的我来说有点难 码姐姐匿名网友 2018-12-08 09:03:29 挺不错的资源，帮了我的大忙，正是我想要的 发表评论 tulangui 资源：1 粉丝：0 +关注 上传资源 免责说明 本站只是提供一个交换下载平台，下载的内容为本站的会员网络搜集上传分享交流使用,有完整的也有可能只有一分部,相关内容的使用请自行研究,主要是提供下载学习交流使用,一般不免费提供其它各种相关服务! 本站内容泄及的知识面非常广,请自行学习掌握,尽量自已动脑动手解决问题,实践是提高本领的途径,下载内容不代表本站的观点或立场!如本站不慎侵犯你的权益请联系我们,我们将马上处理撤下所有相关内容！联系邮箱：server@dude6.com
挺不错的，不过工程好像有些问题
挺好的资源，不过对于初学者的我来说有点难
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