VerilogHDL_uart.zip

Name: VerilogHDL_uart.zip
Rating: 4.5 (26 reviews)
Author: chenlong70192361

上传者：chenlong70192361 2021-04-24 05:44:33上传 ZIP文件 627.53KB 热度 26次

实现了基于verilogHDL 实现的串口通信功能,平台是Cyclone II

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VerilogHDL_uart.zip

实现了基于verilogHDL 实现的串口通信功能,平台是Cyclone II

大小：628KB | 2021-04-24 05:44:33
基于VerilogHDL的UART

基于Verilog的串口设计，里面有任意分频器，发射器，接收器。发射器通过复位启动，接收器接收发射器...

大小：0B | 2019-07-13 18:01:20
RS232UART的VerilogHDL源代码

RS232/UART的VerilogHDL源代码

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基于VerilogHDL的UART串行通讯模块设计及仿真

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VerilogHDL那些事儿.zip

VerilogHDL那些事儿包含modelsim时序,建模等适合新手和初级入门等

大小：81.35MB | 2020-08-21 03:33:56
基于Zynq7020的Uart和PWM的VerilogHDL代码

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UART DMA.zip

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大小：8.66MB | 2023-01-03 10:40:46
1602_UART.zip

本代码为MSP430系列,其他的单片机也可以借鉴。主要实现的功能是使用串口的收发,并在1602显示,...

大小：59KB | 2020-08-07 07:22:23
analog_uart.zip

stm8 开发,IAR平台,C语言,普通IO模拟串口程序,程序默认IO是PD3 ,使用者需要其他IO...

大小：1KB | 2020-08-18 08:18:29
linux_uart.zip

Linux c串口编程,用于48 ports串口服务器串口测试工具,已删减部分功能,只留下串口部分。...

大小：5KB | 2020-08-19 04:07:41
uart_ip.zip

uart的verilog代码。

大小：5KB | 2020-08-12 11:47:09
APB uart.zip

采用Verilog硬件描述语言,实现了32位APB总线下的UART接口设计,能够完美支持各种传输模式...

大小：63KB | 2020-08-14 02:08:38
UART.srcs.zip

使用verilog编写的串口通信协议，在vivado平坦编译下载到atrix-7系列FPGA进行验证...

大小：0B | 2020-06-13 20:39:51
uart_example.zip

在SOC的搭建过程中,CPU通过AMBA规范的AHB-lite总线通过控制模块和外部设备进行数据的交...

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timer_uart.zip

定时器数据接收函数,定时器接收函数

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pandora_uart.zip

这一款开发套件不仅具有丰富的软硬件资源、详尽的例程文档和低成本优势,而且针对物联网产品开发需求深度优...

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