SoC clock and reset系统控制
基于APB总线，片上系统时钟复位管理，可以参考移植其他对时钟复位控制需求的芯片。verilog rtl实现，易于学习并掌握数字设计SoC系统时钟和复位控制
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基于APB总线，片上系统时钟复位管理，可以参考移植其他对时钟复位控制需求的芯片。verilog rtl实现，易于学习并掌握数字设计SoC系统时钟和复位控制
