基于verilog语言程序的定时器设计

Name: 基于verilog语言程序的定时器设计
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Author: dxnnn

上传者：dxnnn 2020-08-20 18:40:28上传 DOCX文件 115.42KB 热度 39次

verilog语言程序,用开关或按键进行定时设置,超过60s为无效设定; 倒计时计数状态用2位数码管显示; 计时结束时用1只彩灯作为提示。

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