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基于CPLD的片内环形振荡器的设计方案

上传者: 2020-08-17 08:05:51上传 PDF文件 139.96KB 热度 16次
本文介绍一种通用的基于CPLD的片内振荡器设计方法,它基于环形振荡器原理,只占用片上普通逻辑资源(LE),无需使用专用逻辑资源(如MaxII中的UFM),从而提高了芯片的资源利用率;振荡频率可在一定范围内调整,振荡输出可以驱动内部逻辑和外部器件引脚。
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