用VHDL实现的4位和8位全加器以及8位寄存器

Name: 用VHDL实现的4位和8位全加器以及8位寄存器
Rating: 4.5 (57 reviews)
Author: qiulinxuel

上传者：qiulinxuel 2018-12-28 17:15:29上传 RAR文件 902.92KB 热度 57次

用VHDL实现的4位和8位全加器以及8位寄存器这是源文件，直接用就可以

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: 码姐姐匿名网友 2018-12-28 17:15:29

可以直接用很好

: 码姐姐匿名网友 2018-12-28 17:15:29

还不错，可以直接用！

: 码姐姐匿名网友 2018-12-28 17:15:29

还不错，可是不符合我们的实验要求。

: 码姐姐匿名网友 2018-12-28 17:15:29

可以直接使用很方便

用VHDL实现的4位和8位全加器以及8位寄存器

用VHDL实现的4位和8位全加器以及8位寄存器这是源文件，直接用就可以

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