浮点除法verilog设计 上传者：woaijj74 2018-12-27 05:45:14上传 ZIP文件 2.77KB 热度 48次 浮点格式遵循 IEEE754 标准。verilog设计源代码。 下载地址 用户评论 更多下载 下载地址 立即下载 用户评论 码姐姐匿名网友 2018-12-27 05:45:14 给出了一些很好的算法 码姐姐匿名网友 2018-12-27 05:45:14 直接用没能成功，大家怎么用的呢 码姐姐匿名网友 2018-12-27 05:45:14 挺适合我现在写的程序 不错 初学者要用可以再改一改 码姐姐匿名网友 2018-12-27 05:45:14 给出了一些很好的算法 很好！！ 码姐姐匿名网友 2018-12-27 05:45:14 不错，代码值借鉴，但不知为什么我仿真不出来。 码姐姐匿名网友 2018-12-27 05:45:14 不错，执行结果也是正确的ieee754的格式 码姐姐匿名网友 2018-12-27 05:45:14 不错，有注释，整体结构也不错 码姐姐匿名网友 2018-12-27 05:45:14 不错，是个Verfilog的divider的完整代码 码姐姐匿名网友 2018-12-27 05:45:14 给出了一些很好的算法 适合初学者 发表评论 woaijj74 资源：6 粉丝：0 +关注 上传资源 免责说明 本站只是提供一个交换下载平台，下载的内容为本站的会员网络搜集上传分享交流使用,有完整的也有可能只有一分部,相关内容的使用请自行研究,主要是提供下载学习交流使用,一般不免费提供其它各种相关服务! 本站内容泄及的知识面非常广,请自行学习掌握,尽量自已动脑动手解决问题,实践是提高本领的途径,下载内容不代表本站的观点或立场!如本站不慎侵犯你的权益请联系我们,我们将马上处理撤下所有相关内容！联系邮箱：server@dude6.com
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直接用没能成功，大家怎么用的呢
挺适合我现在写的程序 不错 初学者要用可以再改一改
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不错，代码值借鉴，但不知为什么我仿真不出来。
不错，执行结果也是正确的ieee754的格式
不错，有注释，整体结构也不错
不错，是个Verfilog的divider的完整代码
给出了一些很好的算法 适合初学者