异步fifo设计

Name: 异步fifo设计
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Author: merlin_y

上传者：merlin_y 2019-07-19 15:28:09上传 DOC文件 161KB 热度 57次

基于verilog的异步fifo设计，有效解决亚稳态的问题，有空满标志，输出加寄存。

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异步fifo设计

基于verilog的异步fifo设计，有效解决亚稳态的问题，有空满标志，输出加寄存。

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