2N次方广谱伪随机信号发生器及VHDL程序

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Author: u579875774

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大小：0B | 2019-05-04 14:46:38
伪随机信号发生器 verilog

大小：0B | 2018-12-07 16:02:02
伪随机信号发生器的研制

很实用的一种伪随机信号发生器！信号开发必备

大小：0B | 2018-12-24 22:56:26
伪随机M序列发生器的vhdl代码及说明

大小：0B | 2018-12-07 16:02:03
伪随机数发生器

Pseudo random number generator

大小：0B | 2019-06-22 05:36:45
Verilog伪随机序列发生器

Verilog 写的伪随机序列发生器，结构清晰，逻辑也挺顺。同步字节、数据包、数据帧这些关键部分都有...

大小：1.13KB | 2025-05-30 10:23:36
伪随机序列发生器 verilog

大小：0B | 2018-12-07 16:02:07
vhdl正弦信号发生器

本设计是基于 FPGA 语言，结合 dds 设计的正弦波发生器。最小频率为 500 hz，最大频率为...

大小：0B | 2019-06-21 10:08:28
随机信号发生器Verilog

使用LFSR和CASR构成随机数或随机信号发生器；Verilog实现

大小：0B | 2019-05-31 23:01:21
最新的伪随机序列发生器

这是本人利用国外最新技术设计的最新的伪随机序列发生器。

大小：0B | 2019-05-14 21:52:55
各类伪随机数发生器

包括三个文件：一个.cpp文件产生0-1均匀随机数，包括C自带的随机数发生器和改进的混沌随机数发生器...

大小：0B | 2019-05-04 02:05:51
fpga信号发生器vhdl代码

产生幅度和频率可变的方波，三角波，正弦波。

大小：0B | 2019-07-06 02:41:49
vhdl语言的信号发生器

基于fpga的信号发生器，用vhdl编写，发出正选波信号，用nco的IP盒。数字频率合成技术

大小：0B | 2019-05-13 06:19:38
基于VHDL dds正弦信号发生器dds正弦信号发生器

dds正弦信号发生器dds正弦信号发生器基于VHDL居于VHDL

大小：0B | 2019-05-28 11:59:56
基于FPGA伪随机序列发生器设计

Design of pseudo-random sequence generator based o...

大小：0B | 2019-06-27 23:03:54
正态分布伪随机数发生器

随着科学技术的发展,工程建设与科学研究对测量定位精度的要求越来越高。这要求测量工作者对测量的仪器、工...

大小：0B | 2019-05-19 17:37:10