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Verilog编写的SDRAM读写控制器

上传者: 2018-12-09 05:02:42上传 RAR文件 2.21MB 热度 76次
Verilog编写的SDRAM读写控制器,经过仿真验证,可以使用的源码,可直接实例化。
用户评论
码姐姐匿名网友 2018-12-09 05:02:42

可以用,并且有testbench,很有参考价值

码姐姐匿名网友 2018-12-09 05:02:42

简洁明了,适合初学者

码姐姐匿名网友 2018-12-09 05:02:42

本来应该是quartus自动生成的SDRAM控制器,然后稍微改过