基于高分辨率A/D转换器和DL技术实现时钟稳定电路的设计

进入21世纪后,人类社会已全面进入信息时代,信息产业成为了现代社会重要的支柱和主要的产业,伴随着半导体技术、数字信号处理技术及通信技术的飞速发展,A/D、D/A转换器近年也呈现高速发展趋势,而随着高速、高 A/D转换器(ADC)的发展,尤其是能直接进行中频采样的高分辨率数据转换器的上市,对稳定的采样时钟的需求越来越迫切,随着通信系统中的时钟速度迈入GHz级,相位噪声和时钟抖动已成为模拟设计中必须要考虑的因素。 数据转换器的主要作用要么是由定期的时间采样产生模拟波形,要么是由一个模拟信号产生一系列定期的时间采样。因此,采样时钟的稳定性十分重要,从数据转换器的角度来看,这种不稳定性(亦即随机的