i2c总线读写模块使用Verilog编写

Name: i2c总线读写模块使用Verilog编写
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Author: border_45959

上传者：border_45959 2021-01-31 18:54:34上传 V文件 38KB 热度 47次

fpga实现了i2c master的时序,支持单次读写操作者

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i2c总线读写模块使用Verilog编写

fpga实现了i2c master的时序,支持单次读写操作者

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