EDA/PLD中的EDA中的智力抢答系统设计方案

根据系统设计要求可知,系统的输入信号有:各组的抢答按钮A、B、c、D,系统清零信号CLR,系统时钟信号CLK,计分复位端RST,加分按钮 端ADD,计时预置控制端LDN,计时使能端EN,计时预置数据调整按钮TA、TB;系统的输出信号有:四个组抢答成功与否的指示灯控制信号输出 口LEDA、LEDB、LEDC、LEDD,四个组抢答时的计时数码显示控制信号若干,抢答成功组别显示的控制信号若干,各组计分动态显示的控制信号 若干。本系统应具有的功能有:第一抢答信号的鉴别和锁存功能;抢答计时功能;各组得分的累加和动态显示功能;抢答犯规记录功能。 根据以上的分析,我们可将整个系统分为三个主要模块:抢答