通信与网络中的采用0.18µm CMOS设计用于2.5Gb/s收发器系统的16:1复用器电路

1 引言 近年来,随着传统电信业务和互联网业务的迅猛发展,它们对网络带宽提出了越来越高的要求,由此导致了高速串行接口的出现。目前国内关于2.5 Gb/s超高速串行收发器CMOS芯片及IP核研究开发尚处于起步阶段。设计开发具有自主知识产权的高性能串行收发器芯片及IP核,打破国外对高端路由器、交换器芯片的垄断,不仅能够直接大幅度降低通信、网络设备成本,产生显著的经济效益,还能带来巨大的社会效益。本文所设计的复用器,应用在2.5Gb/s收发器系统中,该收发器的系统框图如图1所示。 图1 Transceiver结构示意图 众所周知在高速的数据传输系统中,收发器对于实现整个系统