接口/总线/驱动中的关于JESD204B转换器与FPGA匹配的设计关键点

随着更多的模数转换器(ADC)和数模转换器(DAC)支持最新的JESD204B串行接口标准,出现了FPGA与这些模拟产品的最佳接口方式问题。FPGA供应商多年来一直支持千兆串行/解串(SERDES)收发器。然而在过去,大多数ADC和DAC不能通过这些高速串行接口进行配置,就是说FPGA与转换器无法与任何常用标准接口,利用高串行-解串(SERDES)带宽。 JESD204B接口针对支持更高速转换器不断增长的带宽需求而开发,以填补该空白。作为第三代串行数据链路标准,JESD204B提供更高的最大通道速率(每通道高达12.5 Gbps),支持确定延迟和谐波帧时钟。该接口借助兼容开放市场FPGA