硬件描述语言Verilog设计经验总结

粗略地看Verilog与C语言有许多相似之处。分号用于结束每个语句,注释符也是相同的,运算符“==”也用来测试相等性。Verilog的if..then..else语法与C语言的也非常相似,只是Verilog用关键字 begin和end代替了C的大括号。事实上,关键字begin和end对于单语句块来说是可有可无的,就与C中的大括号用法一样。Verilog和C都对大小写敏感。