正交信号发生器.zip

Name: 正交信号发生器.zip
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Author: qq_31656

上传者：qq_31656 2020-09-11 13:36:42上传 ZIP文件 9.16KB 热度 53次

verilog代码,用于FPGA上产生正交正弦信号,没有用到IP核,可方便移植,代码可以直接拿来使用,只需自己建立一个工程放置。

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正交信号发生器.zip

verilog代码,用于FPGA上产生正交正弦信号,没有用到IP核,可方便移植,代码可以直接拿来使用...

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