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FPGA设计中可综合的语法子集

上传者: 2020-08-30 03:45:16上传 PDF文件 52.11KB 热度 10次
可综合的语法是verilog可用语法里很小的一个子集,硬件设计的精髓就是力求用最简单的语句描述最复杂的硬件,这也正是硬件描述语言的本质。对于做RTL级设计来说,掌握好这些基本语法是很重要。
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