Cadence NC_verilog仿真

Name: Cadence NC_verilog仿真
Rating: 4.5 (46 reviews)
Author: 庸亻自扰D

上传者：庸亻自扰D 2020-08-30 00:39:35上传 PDF文件 505.65KB 热度 46次

NC可用于数模混合仿真,即用verilog语言给画的电路图添加输入激励信号,然后查看输出信号,以验证电路是否正确。。

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Cadence NC_verilog仿真

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这个是NC_Verilog中文文档,适合初学者使用,很不错哈。

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很好的NC-verilog的资料,一定要看一下了,很详细的

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