Verilog生成语句以及Xilinx原语的使用示例

Name: Verilog生成语句以及Xilinx原语的使用示例
Rating: 4.5 (50 reviews)
Author: fox97487

上传者：fox97487 2020-08-22 10:07:40上传 PDF文件 24.9KB 热度 50次

最近做QDR II SRAM控制器,要用到xilinx的原语IDDR,我的数据输入输出是18位的,又用到Generate将一位输入输出IDDR扩成18位,以前没用过generate,也不太熟悉,现在已熟悉其应用场合及其用法。

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