用verilog写得一个双口ram模块 上传者：shigaofeng90 2019-01-02 10:04:49上传 其他文件 500kb 热度 45次 下载地址 用户评论 更多下载 下载地址 立即下载 用户评论 码姐姐匿名网友 2019-01-02 10:04:51 没有下载成功 码姐姐匿名网友 2019-01-02 10:04:51 有一定的参考价值 对工作有所帮助 码姐姐匿名网友 2019-01-02 10:04:51 挺不错的呀，可以用，谢谢 码姐姐匿名网友 2019-01-02 10:04:51 真的很实用啊 码姐姐匿名网友 2019-01-02 10:04:51 很好，这样的资料很少。 码姐姐匿名网友 2019-01-02 10:04:51 非常有参考价值！但设计的双端口RAM容量太小，正考虑扩大它的容量！ 码姐姐匿名网友 2019-01-02 10:04:51 我是菜鸟，可是为什么找不到工程。。。 xiaotian_ls 2025-01-08 04:26:20 不是真双口RAM的代码，甚至不是伪双口RAM，只是简单的把数据放到寄存器里，然后读出来，就是一个单端口RAM的读写代码，别下，没用。 发表评论 shigaofeng90 资源：4 粉丝：0 +关注 上传资源 免责说明 本站只是提供一个交换下载平台，下载的内容为本站的会员网络搜集上传分享交流使用,有完整的也有可能只有一分部,相关内容的使用请自行研究,主要是提供下载学习交流使用,一般不免费提供其它各种相关服务! 本站内容泄及的知识面非常广,请自行学习掌握,尽量自已动脑动手解决问题,实践是提高本领的途径,下载内容不代表本站的观点或立场!如本站不慎侵犯你的权益请联系我们,我们将马上处理撤下所有相关内容！联系邮箱：server@dude6.com
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非常有参考价值！但设计的双端口RAM容量太小，正考虑扩大它的容量！
我是菜鸟，可是为什么找不到工程。。。
不是真双口RAM的代码，甚至不是伪双口RAM，只是简单的把数据放到寄存器里，然后读出来，就是一个单端口RAM的读写代码，别下，没用。