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组合逻辑电路的设计实验报告11

上传者: 2020-08-21 03:37:16上传 DOC文件 1.6MB 热度 16次
组合逻辑电路的设计实验报告11 【设计过程】 设输入为A、B、C、D,输出为L,根据要求列出真值表如下 真值表 A B C D L 0 0 0 0 0 0 0 0 1 0 0 0 1 0 0 0 0 1 1 0 0 1 0 0 0 0 1 0 1 0 0 1 1 0 0 0 1 1 1 1 1 0 0 0 0 1 0 0 1 0 1 0 1 0 0 1 0 1 1 1 1 1 0 0 0 1 1 0 1 1 1 1 1 0 1 1 1 1 1 1 根据真值表画卡若图如下
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