简易计算机系统(CPU)综合设计设计报告及工程文件(VHDL).zip
按照给定的数据通路、数据格式和指令系统，使用 EDA 工具设计一台用硬连线逻辑控制的简易计算机。利用QuartusII平台，通过VHDL语言设计完成了一个简易CPU
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