Verilog实例(经典135例) 上传者：xmssy41849 2020-04-30 16:03:49上传 UNKONW文件 500kb 热度 35次 很实用的Verilog实例！ 目录：王金明：《VerilogHDL程序设计教程》程序例子，带说明。 【例3.1】4位全加器 【例3.2】4位计数器 【例3.3】4位全加器的仿真程序 【例3.4】4位计数器的仿真程序 【例3.5】“与-或-非”门电路 【例5.1】用case语句描述的4选1数据选择器 【例5.2】同步置数、同步清零的计数器 【例5.4】用initial过程语句对测试变量A、B、C赋值 【例5.5】用begin-end串行块产生信号波形 【例5.6】用fork-join并行块产生信号波形 【例5.7】持续赋值方式定义的2 下载地址 用户评论 更多下载 下载地址 立即下载 用户评论 码姐姐匿名网友 2020-04-30 16:03:49 非常好的学习资源，谢谢楼主 码姐姐匿名网友 2020-04-30 16:03:49 挺好的，就是太简单 码姐姐匿名网友 2020-04-30 16:03:49 非常经典，感谢分享！学习了 码姐姐匿名网友 2020-04-30 16:03:49 挺不错的资料，谢谢分享 码姐姐匿名网友 2020-04-30 16:03:49 给好评，里面有很多verilog代码实例，但是没有相应的，test代码，需要自己验证一下。 发表评论 xmssy41849 资源：5 粉丝：0 +关注 上传资源 免责说明 本站只是提供一个交换下载平台，下载的内容为本站的会员网络搜集上传分享交流使用,有完整的也有可能只有一分部,相关内容的使用请自行研究,主要是提供下载学习交流使用,一般不免费提供其它各种相关服务! 本站内容泄及的知识面非常广,请自行学习掌握,尽量自已动脑动手解决问题,实践是提高本领的途径,下载内容不代表本站的观点或立场!如本站不慎侵犯你的权益请联系我们,我们将马上处理撤下所有相关内容！联系邮箱：server@dude6.com
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