VHDL语言与数字电路
VHDL语言,非常高速硬件描述语言,也就是一种硬件(数字电路)设计语言.其最大特点是对电路的行为与结构进行高度抽象化规范化,并对设计进行模拟验证与综合优化,使分析和设计高度自动化。
VHDL程序设计教程:http://www.docin.com/p-7513359.html
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