Verilog数字钟(自动计时+手动校时+倒计时+整点报时+LCD显示)附完整源代码、详细注释和word报告.zip

Name: Verilog数字钟(自动计时+手动校时+倒计时+整点报时+LCD显示)附完整源代码、详细注释和word报告.zip
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Author: zhiyongtu

上传者：zhiyongtu 2019-09-29 01:53:50上传 ZIP文件 2.12MB 热度 159次

Verilog数字钟（自动计时+手动校时+倒计时+闹钟+整点报时+LCD显示）附完整源代码、详细注释和word报告。用cycloneⅡ实现。

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Verilog数字钟自动计时加手动校时加倒计时加整点报时加LCD显示附完整源代码详细注释和word报告.zip

Verilog数字钟（自动计时+手动校时+倒计时+闹钟+整点报时+LCD显示）附完整源代码、详细注释...

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