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基于Verilog的伪随机序列的发生及曼彻斯特编码

上传者: 2019-09-19 13:05:06上传 ZIP文件 450KB 热度 48次
本工程为2011年电子设计大赛E题信号发生程序的一部分,实现了伪随机序列的发生及曼彻斯特编码,仿真环境为ISE10.1与ModelSim联合仿真,附有仿真结果图。
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