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CPLD或FPGA开关量信号去抖动

上传者: 2019-07-25 18:13:27上传 ZIP文件 209.7KB 热度 47次
自己写的程序,在CPLD上已调试通过,顶层是一个原理图文件,还有两个VHDL语言写的模块,一个用于内部时钟分频,一个用于去抖。
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