VHDL实现ADC0809采样控制时序模拟

Name: VHDL实现ADC0809采样控制时序模拟
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Author: qq_62631264

上传者：qq_62631264 2019-07-07 19:25:51上传 ZIP文件 4.13MB 热度 49次

采用状态机机制实现ADC0809采样控制，用VHDL编写，开发环境为quartus8.0，利用modesim-altera仿真验证

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