VHDL 伪随机码产生器

Name: VHDL 伪随机码产生器
Rating: 4.5 (70 reviews)
Author: weixin_20421587

上传者：weixin_20421587 2019-05-28 12:13:36上传 VHD文件 1.01KB 热度 70次

VHDL语言写的伪随机序列产生器，7阶，可修改参数为m阶

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: 码姐姐匿名网友 2019-05-28 12:13:36

建议增加其他N取值的情况，例如n=10时如何产生伪随机序列

: 码姐姐匿名网友 2019-05-28 12:13:36

可以作参考，生成随机数

: 码姐姐匿名网友 2019-05-28 12:13:36

可以生成随机数

: 码姐姐匿名网友 2019-05-28 12:13:36

可以用，能够生成随机数

VHDL伪随机码产生器

VHDL语言写的伪随机序列产生器，7阶，可修改参数为m阶

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