VHDL语言的并入串出移位寄存器

Name: VHDL语言的并入串出移位寄存器
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Author: iagyje

上传者：iagyje 2019-04-28 12:51:27上传 TXT文件 590B 热度 94次

VHDL语言的并入串出移位寄存器，适用于可用于控制错误信号的输出！

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VHDL语言的并入串出移位寄存器

VHDL语言的并入串出移位寄存器，适用于可用于控制错误信号的输出！

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