一个8位运算器的设计（Verilog代码和testbench）

Name: 一个8位运算器的设计（Verilog代码和testbench）
Rating: 4.5 (46 reviews)
Author: guoruchao85484

上传者：guoruchao85484 2019-04-27 01:31:32上传 RAR文件 1.01KB 热度 46次

一个简单8位运算器的设计，含有Verilog代码和testbench,可以直接在modelsim中出波形

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用户评论

: 码姐姐匿名网友 2019-04-27 01:31:32

写的太过粗糙

: 码姐姐匿名网友 2019-04-27 01:31:32

非常感谢！

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