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基于verilog的单周期cou设计

上传者: 2019-03-13 21:41:24上传 ZIP文件 3.73MB 热度 21次
本项目主要利用Verilog语言设计一一个基于MIPS架构的CPU。分别设计指令存储器、寄存器堆、ALU、取指令部件、数据存储器、立即数处理单元、主单元控制器、ALU控制单元。内含仿真,可直接仿真验证。
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