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用VHDL语言设计的一个能显示12/24小时计时与报时等功能的时钟。
大小:2.18MB | 2020-06-13 17:23:38 -
设计一个能进行异步全双工串行通信的模块,该模块以固定的串行数据传送格式收发数据。
大小:2.72MB | 2019-07-27 12:16:53 -
大小:0 | 2019-02-24 13:40:18
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