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ise中ROM核加载正弦信号并输出,以及COE文件生成工具。实例化代码及仿真代码
大小：6.4MB | 2021-01-31 13:09:44 -
利用串口上加FIFO，实现总线上数据由FPGA发送给不同的并行串口，vivado2017.4版本进行...
大小：39.54MB | 2020-05-17 23:49:24
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