-
用FPGA的spartan3e系列开发板实现的基于Verilog数据四选一功能的源代码。
大小:844.71KB | 2019-09-06 00:11:05 -
利用VerilogHDL语言在FPGA开发板上面实现利用数码管显示0到99的跑表功能。
大小:35.53KB | 2019-07-05 04:20:23
Ta的上传资源列表
用FPGA的spartan3e系列开发板实现的基于Verilog数据四选一功能的源代码。
利用VerilogHDL语言在FPGA开发板上面实现利用数码管显示0到99的跑表功能。