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在上一小节中，我们已经简要地介绍了Makefile的一些内容。让我们深入了解Makefile的详细编写规则，主要包括语法规则以及如何使用其他语法元素。是不是觉得Makefile就像是编程的“食谱”，一步步告诉你如何做？如果你对这些规则感兴趣，可以点击以下链接获取更多信息：Makefile的基本编写规则、GNU Makefile手册4.3编译规则。

6.2.1 基本语法规则

Makefile的基本语法规则其实并不复杂，就像组装玩具一样有规律可循。它的结构如下所示：

Targets: Prerequisites

    Command

Targets是目标文件名，可以是一个也可以是多个，用空格分开，甚至还可以使用通配符。想象一下，这些文件就像是我们要建造的“房子”，而Prerequisites就是“房子”需要的“建材”，包括目标所依赖的文件。如果这些“建材”比目标更新，那么我们的“房子”就被认为是“过时的”，需要重新建造。至于Command，它就是完成建造任务的“工具”，必须用Tab键开头，如果和Targets在一行，可以用分号隔开。若命令行太长，可以用反斜杠（\）换行。需要注意的是，所有的命令行都应该以Tab键开始，不能偷懒哦！想了解更多关于命令行的使用，可以参考Linux系统Makefile条件编译的语法详解。

6.2 定义变量

在Makefile中定义变量就像在C语言中使用宏一样，它代表了一段文本字符串，在Makefile执行时会自动展开。在C语言中，宏的值是固定的，而在Makefile中，变量的值是可以改变的。这种灵活性就像是一块橡皮泥，可以随意塑造。在定义变量时，名称可以包含字母、数字、下划线（甚至可以以数字开头），但不要用“:”，因为这会引起混淆。如果你想了解更多关于变量的使用和定义，可以参考makefile中变量定义符号.doc和makefile使用变量。