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高速异步FIFO的实现

上传者: 2019-01-19 18:47:59上传 PDF文件 101.12KB 热度 40次
ic设计基础知识,典型模块设计 采用一种新颖的异步FIFO 设计方案,解决FPGA 多时钟系统中不同时钟域传输数据的问题。该 FIFO 实现方案比传统方式简单,工作速度频率高,如设计采用了Verilog HDL 硬件语言描述还具有良好的移植性
用户评论
码姐姐匿名网友 2019-01-19 18:47:59

对亚稳态的处理比较细致,不错